Analysis & Synthesis report for MIPS
Fri Oct 20 10:31:59 2017
Quartus II Version 9.1 Build 350 03/24/2010 Service Pack 2 SJ Web Edition


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; Table of Contents ;
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  1. Legal Notice
  2. Analysis & Synthesis Summary
  3. Analysis & Synthesis Settings
  4. Parallel Compilation
  5. Analysis & Synthesis Source Files Read
  6. Analysis & Synthesis Resource Usage Summary
  7. Analysis & Synthesis Resource Utilization by Entity
  8. Analysis & Synthesis RAM Summary
  9. State Machine - |MIPS|Control:comb_281|state
 10. Registers Removed During Synthesis
 11. General Register Statistics
 12. Multiplexer Restructuring Statistics (Restructuring Performed)
 13. Source assignments for Memoria:Memory|LPM_RAM_DQ:MEM|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated
 14. Source assignments for Memoria:Memory|LPM_RAM_DQ:MEM_plus_One|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated
 15. Source assignments for Memoria:Memory|LPM_RAM_DQ:MEM_plus_Two|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated
 16. Source assignments for Memoria:Memory|LPM_RAM_DQ:MEM_plus_Three|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated
 17. Parameter Settings for User Entity Instance: Memoria:Memory|LPM_RAM_DQ:MEM
 18. Parameter Settings for User Entity Instance: Memoria:Memory|LPM_RAM_DQ:MEM_plus_One
 19. Parameter Settings for User Entity Instance: Memoria:Memory|LPM_RAM_DQ:MEM_plus_Two
 20. Parameter Settings for User Entity Instance: Memoria:Memory|LPM_RAM_DQ:MEM_plus_Three
 21. Parameter Settings for User Entity Instance: ALS:ALU|multiplication:comb_3
 22. Port Connectivity Checks: "Mux32bit_8x1:PC_MUX"
 23. Port Connectivity Checks: "ALS:ALU"
 24. Port Connectivity Checks: "Mux32bits_4x2:RHS_Mux"
 25. Port Connectivity Checks: "Mux5bits_4x2:WriteRegMux"
 26. Port Connectivity Checks: "Mux32bit_8x1:WriteDataMux"
 27. Port Connectivity Checks: "Mux32bits_4x2:MemDataInMux"
 28. Port Connectivity Checks: "Mux32bits_4x2:MemMux"
 29. Port Connectivity Checks: "Control:comb_281"
 30. Analysis & Synthesis Messages
 31. Analysis & Synthesis Suppressed Messages



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; Legal Notice ;
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Copyright (C) 1991-2010 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
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; Analysis & Synthesis Summary                                                      ;
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; Analysis & Synthesis Status        ; Successful - Fri Oct 20 10:31:59 2017        ;
; Quartus II Version                 ; 9.1 Build 350 03/24/2010 SP 2 SJ Web Edition ;
; Revision Name                      ; MIPS                                         ;
; Top-level Entity Name              ; MIPS                                         ;
; Family                             ; Cyclone II                                   ;
; Total logic elements               ; 4,040                                        ;
;     Total combinational functions  ; 2,881                                        ;
;     Dedicated logic registers      ; 1,594                                        ;
; Total registers                    ; 1594                                         ;
; Total pins                         ; 546                                          ;
; Total virtual pins                 ; 0                                            ;
; Total memory bits                  ; 8,192                                        ;
; Embedded Multiplier 9-bit elements ; 0                                            ;
; Total PLLs                         ; 0                                            ;
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; Analysis & Synthesis Settings                                                                                        ;
+----------------------------------------------------------------------------+--------------------+--------------------+
; Option                                                                     ; Setting            ; Default Value      ;
+----------------------------------------------------------------------------+--------------------+--------------------+
; Device                                                                     ; EP2C70F896C6       ;                    ;
; Top-level entity name                                                      ; MIPS               ; MIPS               ;
; Family name                                                                ; Cyclone II         ; Stratix II         ;
; Use Generated Physical Constraints File                                    ; Off                ;                    ;
; Use smart compilation                                                      ; Off                ; Off                ;
; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On                 ; On                 ;
; Enable compact report table                                                ; Off                ; Off                ;
; Restructure Multiplexers                                                   ; Auto               ; Auto               ;
; Create Debugging Nodes for IP Cores                                        ; Off                ; Off                ;
; Preserve fewer node names                                                  ; On                 ; On                 ;
; Disable OpenCore Plus hardware evaluation                                  ; Off                ; Off                ;
; Verilog Version                                                            ; Verilog_2001       ; Verilog_2001       ;
; VHDL Version                                                               ; VHDL_1993          ; VHDL_1993          ;
; State Machine Processing                                                   ; Auto               ; Auto               ;
; Safe State Machine                                                         ; Off                ; Off                ;
; Extract Verilog State Machines                                             ; On                 ; On                 ;
; Extract VHDL State Machines                                                ; On                 ; On                 ;
; Ignore Verilog initial constructs                                          ; Off                ; Off                ;
; Iteration limit for constant Verilog loops                                 ; 5000               ; 5000               ;
; Iteration limit for non-constant Verilog loops                             ; 250                ; 250                ;
; Add Pass-Through Logic to Inferred RAMs                                    ; On                 ; On                 ;
; Parallel Synthesis                                                         ; On                 ; On                 ;
; DSP Block Balancing                                                        ; Auto               ; Auto               ;
; NOT Gate Push-Back                                                         ; On                 ; On                 ;
; Power-Up Don't Care                                                        ; On                 ; On                 ;
; Remove Redundant Logic Cells                                               ; Off                ; Off                ;
; Remove Duplicate Registers                                                 ; On                 ; On                 ;
; Ignore CARRY Buffers                                                       ; Off                ; Off                ;
; Ignore CASCADE Buffers                                                     ; Off                ; Off                ;
; Ignore GLOBAL Buffers                                                      ; Off                ; Off                ;
; Ignore ROW GLOBAL Buffers                                                  ; Off                ; Off                ;
; Ignore LCELL Buffers                                                       ; Off                ; Off                ;
; Ignore SOFT Buffers                                                        ; On                 ; On                 ;
; Limit AHDL Integers to 32 Bits                                             ; Off                ; Off                ;
; Optimization Technique                                                     ; Balanced           ; Balanced           ;
; Carry Chain Length                                                         ; 70                 ; 70                 ;
; Auto Carry Chains                                                          ; On                 ; On                 ;
; Auto Open-Drain Pins                                                       ; On                 ; On                 ;
; Perform WYSIWYG Primitive Resynthesis                                      ; Off                ; Off                ;
; Auto ROM Replacement                                                       ; On                 ; On                 ;
; Auto RAM Replacement                                                       ; On                 ; On                 ;
; Auto Shift Register Replacement                                            ; Auto               ; Auto               ;
; Auto Clock Enable Replacement                                              ; On                 ; On                 ;
; Strict RAM Replacement                                                     ; Off                ; Off                ;
; Allow Synchronous Control Signals                                          ; On                 ; On                 ;
; Force Use of Synchronous Clear Signals                                     ; Off                ; Off                ;
; Auto RAM to Logic Cell Conversion                                          ; Off                ; Off                ;
; Auto Resource Sharing                                                      ; Off                ; Off                ;
; Allow Any RAM Size For Recognition                                         ; Off                ; Off                ;
; Allow Any ROM Size For Recognition                                         ; Off                ; Off                ;
; Allow Any Shift Register Size For Recognition                              ; Off                ; Off                ;
; Use LogicLock Constraints during Resource Balancing                        ; On                 ; On                 ;
; Ignore translate_off and synthesis_off directives                          ; Off                ; Off                ;
; Timing-Driven Synthesis                                                    ; Off                ; Off                ;
; Show Parameter Settings Tables in Synthesis Report                         ; On                 ; On                 ;
; Ignore Maximum Fan-Out Assignments                                         ; Off                ; Off                ;
; Synchronization Register Chain Length                                      ; 2                  ; 2                  ;
; PowerPlay Power Optimization                                               ; Normal compilation ; Normal compilation ;
; HDL message level                                                          ; Level2             ; Level2             ;
; Suppress Register Optimization Related Messages                            ; Off                ; Off                ;
; Number of Removed Registers Reported in Synthesis Report                   ; 5000               ; 5000               ;
; Number of Inverted Registers Reported in Synthesis Report                  ; 100                ; 100                ;
; Clock MUX Protection                                                       ; On                 ; On                 ;
; Auto Gated Clock Conversion                                                ; Off                ; Off                ;
; Block Design Naming                                                        ; Auto               ; Auto               ;
; SDC constraint protection                                                  ; Off                ; Off                ;
; Synthesis Effort                                                           ; Auto               ; Auto               ;
; Shift Register Replacement - Allow Asynchronous Clear Signal               ; On                 ; On                 ;
; Analysis & Synthesis Message Level                                         ; Medium             ; Medium             ;
; Disable Register Merging Across Hierarchies                                ; Auto               ; Auto               ;
; Resource Aware Inference For Block RAM                                     ; On                 ; On                 ;
+----------------------------------------------------------------------------+--------------------+--------------------+


+------------------------------------------+
; Parallel Compilation                     ;
+----------------------------+-------------+
; Processors                 ; Number      ;
+----------------------------+-------------+
; Number detected on machine ; 4           ;
; Maximum allowed            ; 4           ;
;                            ;             ;
; Average used               ; 1.00        ;
; Maximum used               ; 1           ;
;                            ;             ;
; Usage by Processor         ; % Time Used ;
;     1 processor            ; 100.0%      ;
;     2-4 processors         ;   0.0%      ;
+----------------------------+-------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Source Files Read                                                                                                                 ;
+----------------------------------+-----------------+----------------------------------+----------------------------------------------------------------+
; File Name with User-Entered Path ; Used in Netlist ; File Type                        ; File Name with Absolute Path                                   ;
+----------------------------------+-----------------+----------------------------------+----------------------------------------------------------------+
; MemWrapper.sv                    ; yes             ; User SystemVerilog HDL File      ; C:/Users/jraf/Documents/Mips/MemWrapper.sv                     ;
; multiplication.sv                ; yes             ; User SystemVerilog HDL File      ; C:/Users/jraf/Documents/Mips/multiplication.sv                 ;
; ALS.sv                           ; yes             ; User SystemVerilog HDL File      ; C:/Users/jraf/Documents/Mips/ALS.sv                            ;
; SignExtend.sv                    ; yes             ; User SystemVerilog HDL File      ; C:/Users/jraf/Documents/Mips/SignExtend.sv                     ;
; instrucoes.mif                   ; yes             ; User Memory Initialization File  ; C:/Users/jraf/Documents/Mips/instrucoes.mif                    ;
; Control.sv                       ; yes             ; User SystemVerilog HDL File      ; C:/Users/jraf/Documents/Mips/Control.sv                        ;
; Banco_reg.vhd                    ; yes             ; User VHDL File                   ; C:/Users/jraf/Documents/Mips/Banco_reg.vhd                     ;
; Instr_Reg.vhd                    ; yes             ; User VHDL File                   ; C:/Users/jraf/Documents/Mips/Instr_Reg.vhd                     ;
; Memoria.vhd                      ; yes             ; User VHDL File                   ; C:/Users/jraf/Documents/Mips/Memoria.vhd                       ;
; RegDesloc.vhd                    ; yes             ; User VHDL File                   ; C:/Users/jraf/Documents/Mips/RegDesloc.vhd                     ;
; Registrador.vhd                  ; yes             ; User VHDL File                   ; C:/Users/jraf/Documents/Mips/Registrador.vhd                   ;
; ula32.vhd                        ; yes             ; User VHDL File                   ; C:/Users/jraf/Documents/Mips/ula32.vhd                         ;
; MIPS.sv                          ; yes             ; User SystemVerilog HDL File      ; C:/Users/jraf/Documents/Mips/MIPS.sv                           ;
; MUX.sv                           ; yes             ; User SystemVerilog HDL File      ; C:/Users/jraf/Documents/Mips/MUX.sv                            ;
; ZeroExtension.sv                 ; yes             ; User SystemVerilog HDL File      ; C:/Users/jraf/Documents/Mips/ZeroExtension.sv                  ;
; lpm_ram_dq.tdf                   ; yes             ; Megafunction                     ; c:/altera/91sp2/quartus/libraries/megafunctions/lpm_ram_dq.tdf ;
; altram.tdf                       ; yes             ; Megafunction                     ; c:/altera/91sp2/quartus/libraries/megafunctions/altram.tdf     ;
; altsyncram.tdf                   ; yes             ; Megafunction                     ; c:/altera/91sp2/quartus/libraries/megafunctions/altsyncram.tdf ;
; db/altsyncram_e1a1.tdf           ; yes             ; Auto-Generated Megafunction      ; C:/Users/jraf/Documents/Mips/db/altsyncram_e1a1.tdf            ;
+----------------------------------+-----------------+----------------------------------+----------------------------------------------------------------+


+-----------------------------------------------------+
; Analysis & Synthesis Resource Usage Summary         ;
+---------------------------------------------+-------+
; Resource                                    ; Usage ;
+---------------------------------------------+-------+
; Estimated Total logic elements              ; 4,040 ;
;                                             ;       ;
; Total combinational functions               ; 2881  ;
; Logic element usage by number of LUT inputs ;       ;
;     -- 4 input functions                    ; 2183  ;
;     -- 3 input functions                    ; 565   ;
;     -- <=2 input functions                  ; 133   ;
;                                             ;       ;
; Logic elements by mode                      ;       ;
;     -- normal mode                          ; 2793  ;
;     -- arithmetic mode                      ; 88    ;
;                                             ;       ;
; Total registers                             ; 1594  ;
;     -- Dedicated logic registers            ; 1594  ;
;     -- I/O registers                        ; 0     ;
;                                             ;       ;
; I/O pins                                    ; 546   ;
; Total memory bits                           ; 8192  ;
; Maximum fan-out node                        ; Clk   ;
; Maximum fan-out                             ; 1626  ;
; Total fan-out                               ; 17933 ;
; Average fan-out                             ; 3.55  ;
+---------------------------------------------+-------+


+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity                                                                                                                                                                                                                                         ;
+-------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+----------------------------------------------------------------------------------------------------------------+--------------+
; Compilation Hierarchy Node                      ; LC Combinationals ; LC Registers ; Memory Bits ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; Full Hierarchy Name                                                                                            ; Library Name ;
+-------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+----------------------------------------------------------------------------------------------------------------+--------------+
; |MIPS                                           ; 2881 (0)          ; 1594 (0)     ; 8192        ; 0            ; 0       ; 0         ; 546  ; 0            ; |MIPS                                                                                                          ; work         ;
;    |ALS:ALU|                                    ; 921 (0)           ; 199 (0)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|ALS:ALU                                                                                                  ; work         ;
;       |RegDesloc:DESL|                          ; 538 (538)         ; 32 (32)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|ALS:ALU|RegDesloc:DESL                                                                                   ; work         ;
;       |Ula32:ALU|                               ; 210 (210)         ; 0 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|ALS:ALU|Ula32:ALU                                                                                        ; work         ;
;       |multiplication:comb_3|                   ; 173 (173)         ; 167 (167)    ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|ALS:ALU|multiplication:comb_3                                                                            ; work         ;
;    |Banco_reg:Registers|                        ; 1392 (1392)       ; 1024 (1024)  ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Banco_reg:Registers                                                                                      ; work         ;
;    |Control:comb_281|                           ; 194 (194)         ; 83 (83)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Control:comb_281                                                                                         ; work         ;
;    |Instr_Reg:Instruction_Register|             ; 0 (0)             ; 32 (32)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Instr_Reg:Instruction_Register                                                                           ; work         ;
;    |Memoria:Memory|                             ; 23 (23)           ; 0 (0)        ; 8192        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory                                                                                           ; work         ;
;       |lpm_ram_dq:MEM_plus_One|                 ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_One                                                                   ; work         ;
;          |altram:sram|                          ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_One|altram:sram                                                       ;              ;
;             |altsyncram:ram_block|              ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_One|altram:sram|altsyncram:ram_block                                  ;              ;
;                |altsyncram_e1a1:auto_generated| ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_One|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated   ; work         ;
;       |lpm_ram_dq:MEM_plus_Three|               ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_Three                                                                 ; work         ;
;          |altram:sram|                          ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_Three|altram:sram                                                     ; work         ;
;             |altsyncram:ram_block|              ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_Three|altram:sram|altsyncram:ram_block                                ; work         ;
;                |altsyncram_e1a1:auto_generated| ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_Three|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated ; work         ;
;       |lpm_ram_dq:MEM_plus_Two|                 ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_Two                                                                   ; work         ;
;          |altram:sram|                          ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_Two|altram:sram                                                       ; work         ;
;             |altsyncram:ram_block|              ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_Two|altram:sram|altsyncram:ram_block                                  ; work         ;
;                |altsyncram_e1a1:auto_generated| ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM_plus_Two|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated   ; work         ;
;       |lpm_ram_dq:MEM|                          ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM                                                                            ; work         ;
;          |altram:sram|                          ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM|altram:sram                                                                ; work         ;
;             |altsyncram:ram_block|              ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM|altram:sram|altsyncram:ram_block                                           ; work         ;
;                |altsyncram_e1a1:auto_generated| ; 0 (0)             ; 0 (0)        ; 2048        ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Memoria:Memory|lpm_ram_dq:MEM|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated            ; work         ;
;    |Mux32bit_2x1:LHS_Mux|                       ; 1 (1)             ; 0 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Mux32bit_2x1:LHS_Mux                                                                                     ; work         ;
;    |Mux32bit_8x1:PC_MUX|                        ; 106 (106)         ; 0 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Mux32bit_8x1:PC_MUX                                                                                      ; work         ;
;    |Mux32bit_8x1:WriteDataMux|                  ; 95 (95)           ; 0 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Mux32bit_8x1:WriteDataMux                                                                                ; work         ;
;    |Mux32bits_4x2:MemDataInMux|                 ; 24 (24)           ; 0 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Mux32bits_4x2:MemDataInMux                                                                               ; work         ;
;    |Mux32bits_4x2:MemMux|                       ; 34 (34)           ; 0 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Mux32bits_4x2:MemMux                                                                                     ; work         ;
;    |Mux32bits_4x2:RHS_Mux|                      ; 38 (38)           ; 0 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Mux32bits_4x2:RHS_Mux                                                                                    ; work         ;
;    |Mux5bit_2x1:ShiftAmountMux|                 ; 9 (9)             ; 0 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Mux5bit_2x1:ShiftAmountMux                                                                               ; work         ;
;    |Mux5bits_4x2:WriteRegMux|                   ; 5 (5)             ; 0 (0)        ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Mux5bits_4x2:WriteRegMux                                                                                 ; work         ;
;    |Registrador:ALUOut_Reg|                     ; 32 (32)           ; 32 (32)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Registrador:ALUOut_Reg                                                                                   ; work         ;
;    |Registrador:A|                              ; 0 (0)             ; 32 (32)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Registrador:A                                                                                            ; work         ;
;    |Registrador:B|                              ; 0 (0)             ; 32 (32)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Registrador:B                                                                                            ; work         ;
;    |Registrador:ExcProgramCounter|              ; 0 (0)             ; 32 (32)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Registrador:ExcProgramCounter                                                                            ; work         ;
;    |Registrador:HImul|                          ; 0 (0)             ; 32 (32)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Registrador:HImul                                                                                        ; work         ;
;    |Registrador:LOmul|                          ; 0 (0)             ; 32 (32)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Registrador:LOmul                                                                                        ; work         ;
;    |Registrador:MemDataRegister|                ; 0 (0)             ; 32 (32)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Registrador:MemDataRegister                                                                              ; work         ;
;    |Registrador:ProgramCounter|                 ; 7 (7)             ; 32 (32)      ; 0           ; 0            ; 0       ; 0         ; 0    ; 0            ; |MIPS|Registrador:ProgramCounter                                                                               ; work         ;
+-------------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+----------------------------------------------------------------------------------------------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis RAM Summary                                                                                                                                                                                             ;
+---------------------------------------------------------------------------------------------------------------------+------+-------------+--------------+--------------+--------------+--------------+------+----------------+
; Name                                                                                                                ; Type ; Mode        ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Size ; MIF            ;
+---------------------------------------------------------------------------------------------------------------------+------+-------------+--------------+--------------+--------------+--------------+------+----------------+
; Memoria:Memory|lpm_ram_dq:MEM_plus_One|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated|ALTSYNCRAM   ; AUTO ; Single Port ; 256          ; 8            ; --           ; --           ; 2048 ; instrucoes.mif ;
; Memoria:Memory|lpm_ram_dq:MEM_plus_Three|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated|ALTSYNCRAM ; AUTO ; Single Port ; 256          ; 8            ; --           ; --           ; 2048 ; instrucoes.mif ;
; Memoria:Memory|lpm_ram_dq:MEM_plus_Two|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated|ALTSYNCRAM   ; AUTO ; Single Port ; 256          ; 8            ; --           ; --           ; 2048 ; instrucoes.mif ;
; Memoria:Memory|lpm_ram_dq:MEM|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated|ALTSYNCRAM            ; AUTO ; Single Port ; 256          ; 8            ; --           ; --           ; 2048 ; instrucoes.mif ;
+---------------------------------------------------------------------------------------------------------------------+------+-------------+--------------+--------------+--------------+--------------+------+----------------+


Encoding Type:  One-Hot
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; state.R_WAIT_IMMEDIATE           ; 0                   ; 0                  ; 0                   ; 0                  ; 0                  ; 0          ; 0              ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0         ; 0         ; 0        ; 0              ; 0             ; 0          ; 0          ; 0           ; 0           ; 0                          ; 0                         ; 0                         ; 0                           ; 0                           ; 0                                ; 0                               ; 0                               ; 0                         ; 0                         ; 0            ; 0          ; 0         ; 0          ; 0         ; 0         ; 0           ; 0          ; 0          ; 1                      ; 0           ; 0          ; 0          ; 0               ; 0               ; 0                ; 0                     ; 0                     ; 0           ; 0         ; 0         ; 0         ; 0            ; 0         ; 0         ; 0       ; 0         ; 0        ; 0        ; 0         ; 0         ; 0            ; 0                      ; 0                      ; 0           ; 0                ; 1           ;
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; state.SUBU                       ; 0                   ; 0                  ; 0                   ; 0                  ; 0                  ; 0          ; 0              ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0         ; 0         ; 0        ; 0              ; 0             ; 0          ; 0          ; 0           ; 0           ; 0                          ; 0                         ; 0                         ; 0                           ; 0                           ; 0                                ; 0                               ; 0                               ; 0                         ; 0                         ; 0            ; 0          ; 0         ; 0          ; 0         ; 0         ; 0           ; 1          ; 0          ; 0                      ; 0           ; 0          ; 0          ; 0               ; 0               ; 0                ; 0                     ; 0                     ; 0           ; 0         ; 0         ; 0         ; 0            ; 0         ; 0         ; 0       ; 0         ; 0        ; 0        ; 0         ; 0         ; 0            ; 0                      ; 0                      ; 0           ; 0                ; 1           ;
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; state.S_WAIT                     ; 0                   ; 0                  ; 0                   ; 0                  ; 0                  ; 0          ; 0              ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0         ; 0         ; 0        ; 0              ; 0             ; 0          ; 0          ; 0           ; 0           ; 0                          ; 0                         ; 0                         ; 0                           ; 0                           ; 0                                ; 0                               ; 0                               ; 0                         ; 0                         ; 1            ; 0          ; 0         ; 0          ; 0         ; 0         ; 0           ; 0          ; 0          ; 0                      ; 0           ; 0          ; 0          ; 0               ; 0               ; 0                ; 0                     ; 0                     ; 0           ; 0         ; 0         ; 0         ; 0            ; 0         ; 0         ; 0       ; 0         ; 0        ; 0        ; 0         ; 0         ; 0            ; 0                      ; 0                      ; 0           ; 0                ; 1           ;
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; state.TREATING_OVERFLOW_2        ; 0                   ; 0                  ; 0                   ; 0                  ; 0                  ; 0          ; 0              ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0         ; 0         ; 0        ; 0              ; 0             ; 0          ; 0          ; 0           ; 0           ; 0                          ; 0                         ; 0                         ; 0                           ; 0                           ; 0                                ; 0                               ; 0                               ; 1                         ; 0                         ; 0            ; 0          ; 0         ; 0          ; 0         ; 0         ; 0           ; 0          ; 0          ; 0                      ; 0           ; 0          ; 0          ; 0               ; 0               ; 0                ; 0                     ; 0                     ; 0           ; 0         ; 0         ; 0         ; 0            ; 0         ; 0         ; 0       ; 0         ; 0        ; 0        ; 0         ; 0         ; 0            ; 0                      ; 0                      ; 0           ; 0                ; 1           ;
; state.OVERFLOW_EXCEPTION_DELAY1  ; 0                   ; 0                  ; 0                   ; 0                  ; 0                  ; 0          ; 0              ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0         ; 0         ; 0        ; 0              ; 0             ; 0          ; 0          ; 0           ; 0           ; 0                          ; 0                         ; 0                         ; 0                           ; 0                           ; 0                                ; 0                               ; 1                               ; 0                         ; 0                         ; 0            ; 0          ; 0         ; 0          ; 0         ; 0         ; 0           ; 0          ; 0          ; 0                      ; 0           ; 0          ; 0          ; 0               ; 0               ; 0                ; 0                     ; 0                     ; 0           ; 0         ; 0         ; 0         ; 0            ; 0         ; 0         ; 0       ; 0         ; 0        ; 0        ; 0         ; 0         ; 0            ; 0                      ; 0                      ; 0           ; 0                ; 1           ;
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; state.LHU_2                      ; 0                   ; 0                  ; 0                   ; 0                  ; 0                  ; 0          ; 0              ; 0           ; 0                  ; 0                  ; 1           ; 0           ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0         ; 0         ; 0        ; 0              ; 0             ; 0          ; 0          ; 0           ; 0           ; 0                          ; 0                         ; 0                         ; 0                           ; 0                           ; 0                                ; 0                               ; 0                               ; 0                         ; 0                         ; 0            ; 0          ; 0         ; 0          ; 0         ; 0         ; 0           ; 0          ; 0          ; 0                      ; 0           ; 0          ; 0          ; 0               ; 0               ; 0                ; 0                     ; 0                     ; 0           ; 0         ; 0         ; 0         ; 0            ; 0         ; 0         ; 0       ; 0         ; 0        ; 0        ; 0         ; 0         ; 0            ; 0                      ; 0                      ; 0           ; 0                ; 1           ;
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; state.SHF_LOAD_SRL               ; 0                   ; 0                  ; 0                   ; 1                  ; 0                  ; 0          ; 0              ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0         ; 0         ; 0        ; 0              ; 0             ; 0          ; 0          ; 0           ; 0           ; 0                          ; 0                         ; 0                         ; 0                           ; 0                           ; 0                                ; 0                               ; 0                               ; 0                         ; 0                         ; 0            ; 0          ; 0         ; 0          ; 0         ; 0         ; 0           ; 0          ; 0          ; 0                      ; 0           ; 0          ; 0          ; 0               ; 0               ; 0                ; 0                     ; 0                     ; 0           ; 0         ; 0         ; 0         ; 0            ; 0         ; 0         ; 0       ; 0         ; 0        ; 0        ; 0         ; 0         ; 0            ; 0                      ; 0                      ; 0           ; 0                ; 1           ;
; state.SHF_LOAD_SLLV              ; 0                   ; 0                  ; 1                   ; 0                  ; 0                  ; 0          ; 0              ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0         ; 0         ; 0        ; 0              ; 0             ; 0          ; 0          ; 0           ; 0           ; 0                          ; 0                         ; 0                         ; 0                           ; 0                           ; 0                                ; 0                               ; 0                               ; 0                         ; 0                         ; 0            ; 0          ; 0         ; 0          ; 0         ; 0         ; 0           ; 0          ; 0          ; 0                      ; 0           ; 0          ; 0          ; 0               ; 0               ; 0                ; 0                     ; 0                     ; 0           ; 0         ; 0         ; 0         ; 0            ; 0         ; 0         ; 0       ; 0         ; 0        ; 0        ; 0         ; 0         ; 0            ; 0                      ; 0                      ; 0           ; 0                ; 1           ;
; state.SHF_LOAD_SRA               ; 0                   ; 1                  ; 0                   ; 0                  ; 0                  ; 0          ; 0              ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0         ; 0         ; 0        ; 0              ; 0             ; 0          ; 0          ; 0           ; 0           ; 0                          ; 0                         ; 0                         ; 0                           ; 0                           ; 0                                ; 0                               ; 0                               ; 0                         ; 0                         ; 0            ; 0          ; 0         ; 0          ; 0         ; 0         ; 0           ; 0          ; 0          ; 0                      ; 0           ; 0          ; 0          ; 0               ; 0               ; 0                ; 0                     ; 0                     ; 0           ; 0         ; 0         ; 0         ; 0            ; 0         ; 0         ; 0       ; 0         ; 0        ; 0        ; 0         ; 0         ; 0            ; 0                      ; 0                      ; 0           ; 0                ; 1           ;
; state.SHF_LOAD_SRAV              ; 1                   ; 0                  ; 0                   ; 0                  ; 0                  ; 0          ; 0              ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0           ; 0                  ; 0                  ; 0           ; 0           ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0              ; 0               ; 0               ; 0               ; 0                     ; 0         ; 0         ; 0        ; 0              ; 0             ; 0          ; 0          ; 0           ; 0           ; 0                          ; 0                         ; 0                         ; 0                           ; 0                           ; 0                                ; 0                               ; 0                               ; 0                         ; 0                         ; 0            ; 0          ; 0         ; 0          ; 0         ; 0         ; 0           ; 0          ; 0          ; 0                      ; 0           ; 0          ; 0          ; 0               ; 0               ; 0                ; 0                     ; 0                     ; 0           ; 0         ; 0         ; 0         ; 0            ; 0         ; 0         ; 0       ; 0         ; 0        ; 0        ; 0         ; 0         ; 0            ; 0                      ; 0                      ; 0           ; 0                ; 1           ;
+----------------------------------+---------------------+--------------------+---------------------+--------------------+--------------------+------------+----------------+-------------+--------------------+--------------------+-------------+-------------+-------------+--------------------+--------------------+-------------+-------------+----------------+-----------------+-----------------+-----------------+-----------------------+----------------+-----------------+-----------------+-----------------+-----------------------+-----------+-----------+----------+----------------+---------------+------------+------------+-------------+-------------+----------------------------+---------------------------+---------------------------+-----------------------------+-----------------------------+----------------------------------+---------------------------------+---------------------------------+---------------------------+---------------------------+--------------+------------+-----------+------------+-----------+-----------+-------------+------------+------------+------------------------+-------------+------------+------------+-----------------+-----------------+------------------+-----------------------+-----------------------+-------------+-----------+-----------+-----------+--------------+-----------+-----------+---------+-----------+----------+----------+-----------+-----------+--------------+------------------------+------------------------+-------------+------------------+-------------+


+------------------------------------------------------------+
; Registers Removed During Synthesis                         ;
+---------------------------------------+--------------------+
; Register name                         ; Reason for Removal ;
+---------------------------------------+--------------------+
; Control:comb_281|state~4              ; Lost fanout        ;
; Control:comb_281|state~5              ; Lost fanout        ;
; Control:comb_281|state~6              ; Lost fanout        ;
; Control:comb_281|state~7              ; Lost fanout        ;
; Control:comb_281|state~8              ; Lost fanout        ;
; Control:comb_281|state~9              ; Lost fanout        ;
; Control:comb_281|state~10             ; Lost fanout        ;
; Control:comb_281|state~11             ; Lost fanout        ;
; Total Number of Removed Registers = 8 ;                    ;
+---------------------------------------+--------------------+


+------------------------------------------------------+
; General Register Statistics                          ;
+----------------------------------------------+-------+
; Statistic                                    ; Value ;
+----------------------------------------------+-------+
; Total registers                              ; 1594  ;
; Number of registers using Synchronous Clear  ; 83    ;
; Number of registers using Synchronous Load   ; 92    ;
; Number of registers using Asynchronous Clear ; 1395  ;
; Number of registers using Asynchronous Load  ; 0     ;
; Number of registers using Clock Enable       ; 1502  ;
; Number of registers using Preset             ; 0     ;
+----------------------------------------------+-------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Multiplexer Restructuring Statistics (Restructuring Performed)                                                                                                     ;
+--------------------+-----------+---------------+----------------------+------------------------+------------+------------------------------------------------------+
; Multiplexer Inputs ; Bus Width ; Baseline Area ; Area if Restructured ; Saving if Restructured ; Registered ; Example Multiplexer Output                           ;
+--------------------+-----------+---------------+----------------------+------------------------+------------+------------------------------------------------------+
; 4:1                ; 32 bits   ; 64 LEs        ; 64 LEs               ; 0 LEs                  ; Yes        ; |MIPS|Registrador:ALUOut_Reg|Saida[1]                ;
; 4:1                ; 2 bits    ; 4 LEs         ; 2 LEs                ; 2 LEs                  ; Yes        ; |MIPS|ALS:ALU|multiplication:comb_3|multiplier[31]   ;
; 4:1                ; 32 bits   ; 64 LEs        ; 32 LEs               ; 32 LEs                 ; Yes        ; |MIPS|ALS:ALU|multiplication:comb_3|multiplicand[54] ;
; 4:1                ; 62 bits   ; 124 LEs       ; 62 LEs               ; 62 LEs                 ; Yes        ; |MIPS|ALS:ALU|multiplication:comb_3|multiplier[15]   ;
; 8:1                ; 2 bits    ; 10 LEs        ; 10 LEs               ; 0 LEs                  ; Yes        ; |MIPS|Registrador:ProgramCounter|Saida[1]            ;
; 8:1                ; 4 bits    ; 20 LEs        ; 12 LEs               ; 8 LEs                  ; Yes        ; |MIPS|Registrador:ProgramCounter|Saida[28]           ;
; 8:1                ; 20 bits   ; 100 LEs       ; 80 LEs               ; 20 LEs                 ; Yes        ; |MIPS|Registrador:ProgramCounter|Saida[21]           ;
; 8:1                ; 6 bits    ; 30 LEs        ; 30 LEs               ; 0 LEs                  ; Yes        ; |MIPS|Registrador:ProgramCounter|Saida[2]            ;
; 3:1                ; 6 bits    ; 12 LEs        ; 6 LEs                ; 6 LEs                  ; Yes        ; |MIPS|ALS:ALU|multiplication:comb_3|counter[0]       ;
; 5:1                ; 64 bits   ; 192 LEs       ; 64 LEs               ; 128 LEs                ; Yes        ; |MIPS|ALS:ALU|multiplication:comb_3|result[35]       ;
; 32:1               ; 32 bits   ; 672 LEs       ; 672 LEs              ; 0 LEs                  ; Yes        ; |MIPS|Registrador:B|Saida[9]                         ;
; 32:1               ; 32 bits   ; 672 LEs       ; 672 LEs              ; 0 LEs                  ; Yes        ; |MIPS|Registrador:A|Saida[13]                        ;
; 13:1               ; 12 bits   ; 96 LEs        ; 72 LEs               ; 24 LEs                 ; Yes        ; |MIPS|ALS:ALU|RegDesloc:DESL|temp[4]                 ;
; 13:1               ; 12 bits   ; 96 LEs        ; 72 LEs               ; 24 LEs                 ; Yes        ; |MIPS|ALS:ALU|RegDesloc:DESL|temp[26]                ;
; 4:1                ; 8 bits    ; 16 LEs        ; 16 LEs               ; 0 LEs                  ; No         ; |MIPS|Mux32bits_4x2:MemDataInMux|Mux23               ;
; 4:1                ; 16 bits   ; 32 LEs        ; 32 LEs               ; 0 LEs                  ; No         ; |MIPS|Mux32bits_4x2:MemDataInMux|Mux11               ;
; 4:1                ; 32 bits   ; 64 LEs        ; 64 LEs               ; 0 LEs                  ; No         ; |MIPS|Mux32bits_4x2:MemMux|Mux3                      ;
; 4:1                ; 5 bits    ; 10 LEs        ; 10 LEs               ; 0 LEs                  ; No         ; |MIPS|Mux5bits_4x2:WriteRegMux|Mux0                  ;
; 3:1                ; 2 bits    ; 4 LEs         ; 4 LEs                ; 0 LEs                  ; No         ; |MIPS|Mux32bits_4x2:RHS_Mux|Mux31                    ;
; 3:1                ; 15 bits   ; 30 LEs        ; 30 LEs               ; 0 LEs                  ; No         ; |MIPS|Mux32bits_4x2:RHS_Mux|Mux8                     ;
; 3:1                ; 15 bits   ; 30 LEs        ; 15 LEs               ; 15 LEs                 ; No         ; |MIPS|Control:comb_281|state                         ;
; 8:1                ; 8 bits    ; 40 LEs        ; 24 LEs               ; 16 LEs                 ; No         ; |MIPS|Mux32bit_8x1:WriteDataMux|Mux17                ;
; 8:1                ; 7 bits    ; 35 LEs        ; 21 LEs               ; 14 LEs                 ; No         ; |MIPS|Mux32bit_8x1:WriteDataMux|Mux26                ;
; 8:1                ; 16 bits   ; 80 LEs        ; 48 LEs               ; 32 LEs                 ; No         ; |MIPS|Mux32bit_8x1:WriteDataMux|Mux15                ;
; 4:1                ; 15 bits   ; 30 LEs        ; 30 LEs               ; 0 LEs                  ; No         ; |MIPS|Mux32bits_4x2:RHS_Mux|Mux19                    ;
; 8:1                ; 32 bits   ; 160 LEs       ; 64 LEs               ; 96 LEs                 ; No         ; |MIPS|ALS:ALU|Ula32:ALU|Mux50                        ;
; 8:1                ; 32 bits   ; 160 LEs       ; 96 LEs               ; 64 LEs                 ; No         ; |MIPS|ALS:ALU|Ula32:ALU|Mux30                        ;
; 4:1                ; 2 bits    ; 4 LEs         ; 2 LEs                ; 2 LEs                  ; No         ; |MIPS|Control:comb_281|state                         ;
+--------------------+-----------+---------------+----------------------+------------------------+------------+------------------------------------------------------+


+----------------------------------------------------------------------------------------------------------------------+
; Source assignments for Memoria:Memory|LPM_RAM_DQ:MEM|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated ;
+---------------------------------+--------------------+------+--------------------------------------------------------+
; Assignment                      ; Value              ; From ; To                                                     ;
+---------------------------------+--------------------+------+--------------------------------------------------------+
; OPTIMIZE_POWER_DURING_SYNTHESIS ; NORMAL_COMPILATION ; -    ; -                                                      ;
+---------------------------------+--------------------+------+--------------------------------------------------------+


+-------------------------------------------------------------------------------------------------------------------------------+
; Source assignments for Memoria:Memory|LPM_RAM_DQ:MEM_plus_One|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated ;
+---------------------------------+--------------------+------+-----------------------------------------------------------------+
; Assignment                      ; Value              ; From ; To                                                              ;
+---------------------------------+--------------------+------+-----------------------------------------------------------------+
; OPTIMIZE_POWER_DURING_SYNTHESIS ; NORMAL_COMPILATION ; -    ; -                                                               ;
+---------------------------------+--------------------+------+-----------------------------------------------------------------+


+-------------------------------------------------------------------------------------------------------------------------------+
; Source assignments for Memoria:Memory|LPM_RAM_DQ:MEM_plus_Two|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated ;
+---------------------------------+--------------------+------+-----------------------------------------------------------------+
; Assignment                      ; Value              ; From ; To                                                              ;
+---------------------------------+--------------------+------+-----------------------------------------------------------------+
; OPTIMIZE_POWER_DURING_SYNTHESIS ; NORMAL_COMPILATION ; -    ; -                                                               ;
+---------------------------------+--------------------+------+-----------------------------------------------------------------+


+---------------------------------------------------------------------------------------------------------------------------------+
; Source assignments for Memoria:Memory|LPM_RAM_DQ:MEM_plus_Three|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated ;
+---------------------------------+--------------------+------+-------------------------------------------------------------------+
; Assignment                      ; Value              ; From ; To                                                                ;
+---------------------------------+--------------------+------+-------------------------------------------------------------------+
; OPTIMIZE_POWER_DURING_SYNTHESIS ; NORMAL_COMPILATION ; -    ; -                                                                 ;
+---------------------------------+--------------------+------+-------------------------------------------------------------------+


+----------------------------------------------------------------------------+
; Parameter Settings for User Entity Instance: Memoria:Memory|LPM_RAM_DQ:MEM ;
+------------------------+----------------+----------------------------------+
; Parameter Name         ; Value          ; Type                             ;
+------------------------+----------------+----------------------------------+
; LPM_WIDTH              ; 8              ; Signed Integer                   ;
; LPM_WIDTHAD            ; 8              ; Signed Integer                   ;
; LPM_NUMWORDS           ; 0              ; Signed Integer                   ;
; LPM_INDATA             ; REGISTERED     ; Untyped                          ;
; LPM_ADDRESS_CONTROL    ; REGISTERED     ; Untyped                          ;
; LPM_OUTDATA            ; REGISTERED     ; Untyped                          ;
; LPM_FILE               ; instrucoes.mif ; Untyped                          ;
; USE_EAB                ; ON             ; Untyped                          ;
; DEVICE_FAMILY          ; Cyclone II     ; Untyped                          ;
; CBXI_PARAMETER         ; NOTHING        ; Untyped                          ;
; AUTO_CARRY_CHAINS      ; ON             ; AUTO_CARRY                       ;
; IGNORE_CARRY_BUFFERS   ; OFF            ; IGNORE_CARRY                     ;
; AUTO_CASCADE_CHAINS    ; ON             ; AUTO_CASCADE                     ;
; IGNORE_CASCADE_BUFFERS ; OFF            ; IGNORE_CASCADE                   ;
+------------------------+----------------+----------------------------------+
Note: In order to hide this table in the UI and the text report file, please set the "Show Parameter Settings Tables in Synthesis Report" option in "Analysis and Synthesis Settings -> More Settings" to "Off".


+-------------------------------------------------------------------------------------+
; Parameter Settings for User Entity Instance: Memoria:Memory|LPM_RAM_DQ:MEM_plus_One ;
+------------------------+----------------+-------------------------------------------+
; Parameter Name         ; Value          ; Type                                      ;
+------------------------+----------------+-------------------------------------------+
; LPM_WIDTH              ; 8              ; Signed Integer                            ;
; LPM_WIDTHAD            ; 8              ; Signed Integer                            ;
; LPM_NUMWORDS           ; 0              ; Signed Integer                            ;
; LPM_INDATA             ; REGISTERED     ; Untyped                                   ;
; LPM_ADDRESS_CONTROL    ; REGISTERED     ; Untyped                                   ;
; LPM_OUTDATA            ; REGISTERED     ; Untyped                                   ;
; LPM_FILE               ; instrucoes.mif ; Untyped                                   ;
; USE_EAB                ; ON             ; Untyped                                   ;
; DEVICE_FAMILY          ; Cyclone II     ; Untyped                                   ;
; CBXI_PARAMETER         ; NOTHING        ; Untyped                                   ;
; AUTO_CARRY_CHAINS      ; ON             ; AUTO_CARRY                                ;
; IGNORE_CARRY_BUFFERS   ; OFF            ; IGNORE_CARRY                              ;
; AUTO_CASCADE_CHAINS    ; ON             ; AUTO_CASCADE                              ;
; IGNORE_CASCADE_BUFFERS ; OFF            ; IGNORE_CASCADE                            ;
+------------------------+----------------+-------------------------------------------+
Note: In order to hide this table in the UI and the text report file, please set the "Show Parameter Settings Tables in Synthesis Report" option in "Analysis and Synthesis Settings -> More Settings" to "Off".


+-------------------------------------------------------------------------------------+
; Parameter Settings for User Entity Instance: Memoria:Memory|LPM_RAM_DQ:MEM_plus_Two ;
+------------------------+----------------+-------------------------------------------+
; Parameter Name         ; Value          ; Type                                      ;
+------------------------+----------------+-------------------------------------------+
; LPM_WIDTH              ; 8              ; Signed Integer                            ;
; LPM_WIDTHAD            ; 8              ; Signed Integer                            ;
; LPM_NUMWORDS           ; 0              ; Signed Integer                            ;
; LPM_INDATA             ; REGISTERED     ; Untyped                                   ;
; LPM_ADDRESS_CONTROL    ; REGISTERED     ; Untyped                                   ;
; LPM_OUTDATA            ; REGISTERED     ; Untyped                                   ;
; LPM_FILE               ; instrucoes.mif ; Untyped                                   ;
; USE_EAB                ; ON             ; Untyped                                   ;
; DEVICE_FAMILY          ; Cyclone II     ; Untyped                                   ;
; CBXI_PARAMETER         ; NOTHING        ; Untyped                                   ;
; AUTO_CARRY_CHAINS      ; ON             ; AUTO_CARRY                                ;
; IGNORE_CARRY_BUFFERS   ; OFF            ; IGNORE_CARRY                              ;
; AUTO_CASCADE_CHAINS    ; ON             ; AUTO_CASCADE                              ;
; IGNORE_CASCADE_BUFFERS ; OFF            ; IGNORE_CASCADE                            ;
+------------------------+----------------+-------------------------------------------+
Note: In order to hide this table in the UI and the text report file, please set the "Show Parameter Settings Tables in Synthesis Report" option in "Analysis and Synthesis Settings -> More Settings" to "Off".


+---------------------------------------------------------------------------------------+
; Parameter Settings for User Entity Instance: Memoria:Memory|LPM_RAM_DQ:MEM_plus_Three ;
+------------------------+----------------+---------------------------------------------+
; Parameter Name         ; Value          ; Type                                        ;
+------------------------+----------------+---------------------------------------------+
; LPM_WIDTH              ; 8              ; Signed Integer                              ;
; LPM_WIDTHAD            ; 8              ; Signed Integer                              ;
; LPM_NUMWORDS           ; 0              ; Signed Integer                              ;
; LPM_INDATA             ; REGISTERED     ; Untyped                                     ;
; LPM_ADDRESS_CONTROL    ; REGISTERED     ; Untyped                                     ;
; LPM_OUTDATA            ; REGISTERED     ; Untyped                                     ;
; LPM_FILE               ; instrucoes.mif ; Untyped                                     ;
; USE_EAB                ; ON             ; Untyped                                     ;
; DEVICE_FAMILY          ; Cyclone II     ; Untyped                                     ;
; CBXI_PARAMETER         ; NOTHING        ; Untyped                                     ;
; AUTO_CARRY_CHAINS      ; ON             ; AUTO_CARRY                                  ;
; IGNORE_CARRY_BUFFERS   ; OFF            ; IGNORE_CARRY                                ;
; AUTO_CASCADE_CHAINS    ; ON             ; AUTO_CASCADE                                ;
; IGNORE_CASCADE_BUFFERS ; OFF            ; IGNORE_CASCADE                              ;
+------------------------+----------------+---------------------------------------------+
Note: In order to hide this table in the UI and the text report file, please set the "Show Parameter Settings Tables in Synthesis Report" option in "Analysis and Synthesis Settings -> More Settings" to "Off".


+----------------------------------------------------------------------------+
; Parameter Settings for User Entity Instance: ALS:ALU|multiplication:comb_3 ;
+----------------+--------+--------------------------------------------------+
; Parameter Name ; Value  ; Type                                             ;
+----------------+--------+--------------------------------------------------+
; MULT_IDLE      ; 000000 ; Unsigned Binary                                  ;
; MULT_INIT      ; 000001 ; Unsigned Binary                                  ;
; MULT_WORK      ; 000010 ; Unsigned Binary                                  ;
+----------------+--------+--------------------------------------------------+
Note: In order to hide this table in the UI and the text report file, please set the "Show Parameter Settings Tables in Synthesis Report" option in "Analysis and Synthesis Settings -> More Settings" to "Off".


+-------------------------------------------------+
; Port Connectivity Checks: "Mux32bit_8x1:PC_MUX" ;
+------------+-------+----------+-----------------+
; Port       ; Type  ; Severity ; Details         ;
+------------+-------+----------+-----------------+
; in2[1..0]  ; Input ; Info     ; Stuck at GND    ;
; in6[31..8] ; Input ; Info     ; Stuck at GND    ;
; in7        ; Input ; Info     ; Stuck at GND    ;
+------------+-------+----------+-----------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Port Connectivity Checks: "ALS:ALU"                                                                                                                                     ;
+-------+-------+----------+----------------------------------------------------------------------------------------------------------------------------------------------+
; Port  ; Type  ; Severity ; Details                                                                                                                                      ;
+-------+-------+----------+----------------------------------------------------------------------------------------------------------------------------------------------+
; reset ; Input ; Warning  ; Declared by entity but not connected by instance. If a default value exists, it will be used.  Otherwise, the port will be connected to GND. ;
+-------+-------+----------+----------------------------------------------------------------------------------------------------------------------------------------------+


+---------------------------------------------------+
; Port Connectivity Checks: "Mux32bits_4x2:RHS_Mux" ;
+------------+-------+----------+-------------------+
; Port       ; Type  ; Severity ; Details           ;
+------------+-------+----------+-------------------+
; in1[31..3] ; Input ; Info     ; Stuck at GND      ;
; in1[1..0]  ; Input ; Info     ; Stuck at GND      ;
; in1[2]     ; Input ; Info     ; Stuck at VCC      ;
; in3[1..0]  ; Input ; Info     ; Stuck at GND      ;
+------------+-------+----------+-------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Port Connectivity Checks: "Mux5bits_4x2:WriteRegMux"                                                                                                                                                            ;
+-----------+-------+----------+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Port      ; Type  ; Severity ; Details                                                                                                                                                                          ;
+-----------+-------+----------+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; in2       ; Input ; Warning  ; Input port expression (6 bits) is wider than the input port (5 bits) it drives.  The 1 most-significant bit(s) in the expression will be dangling if they have no other fanouts. ;
; in2[4..2] ; Input ; Info     ; Stuck at VCC                                                                                                                                                                     ;
; in2[1]    ; Input ; Info     ; Stuck at GND                                                                                                                                                                     ;
; in2[0]    ; Input ; Info     ; Stuck at VCC                                                                                                                                                                     ;
; in3       ; Input ; Warning  ; Input port expression (6 bits) is wider than the input port (5 bits) it drives.  The 1 most-significant bit(s) in the expression will be dangling if they have no other fanouts. ;
; in3[4..0] ; Input ; Info     ; Stuck at VCC                                                                                                                                                                     ;
+-----------+-------+----------+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+


+-------------------------------------------------------+
; Port Connectivity Checks: "Mux32bit_8x1:WriteDataMux" ;
+------------+-------+----------+-----------------------+
; Port       ; Type  ; Severity ; Details               ;
+------------+-------+----------+-----------------------+
; in2[15..0] ; Input ; Info     ; Stuck at GND          ;
; in3[7..5]  ; Input ; Info     ; Stuck at VCC          ;
; in3[1..0]  ; Input ; Info     ; Stuck at VCC          ;
; in3[31..8] ; Input ; Info     ; Stuck at GND          ;
; in3[4..2]  ; Input ; Info     ; Stuck at GND          ;
; in4[31..1] ; Input ; Info     ; Stuck at GND          ;
+------------+-------+----------+-----------------------+


+--------------------------------------------------------+
; Port Connectivity Checks: "Mux32bits_4x2:MemDataInMux" ;
+------+-------+----------+------------------------------+
; Port ; Type  ; Severity ; Details                      ;
+------+-------+----------+------------------------------+
; in3  ; Input ; Info     ; Stuck at GND                 ;
+------+-------+----------+------------------------------+


+--------------------------------------------------+
; Port Connectivity Checks: "Mux32bits_4x2:MemMux" ;
+------------+-------+----------+------------------+
; Port       ; Type  ; Severity ; Details          ;
+------------+-------+----------+------------------+
; in2[7..2]  ; Input ; Info     ; Stuck at VCC     ;
; in2[31..8] ; Input ; Info     ; Stuck at GND     ;
; in2[1..0]  ; Input ; Info     ; Stuck at GND     ;
; in3        ; Input ; Info     ; Stuck at GND     ;
+------------+-------+----------+------------------+


+-----------------------------------------------------------------------------------------------------------------------+
; Port Connectivity Checks: "Control:comb_281"                                                                          ;
+-------------+--------+----------+-------------------------------------------------------------------------------------+
; Port        ; Type   ; Severity ; Details                                                                             ;
+-------------+--------+----------+-------------------------------------------------------------------------------------+
; PCWriteCond ; Output ; Info     ; Connected to dangling logic. Logic that only feeds a dangling port will be removed. ;
; PCWrite     ; Output ; Info     ; Connected to dangling logic. Logic that only feeds a dangling port will be removed. ;
; RGD_reset   ; Output ; Info     ; Connected to dangling logic. Logic that only feeds a dangling port will be removed. ;
; RGD_load    ; Output ; Info     ; Connected to dangling logic. Logic that only feeds a dangling port will be removed. ;
+-------------+--------+----------+-------------------------------------------------------------------------------------+


+-------------------------------+
; Analysis & Synthesis Messages ;
+-------------------------------+
Info: *******************************************************************
Info: Running Quartus II Analysis & Synthesis
    Info: Version 9.1 Build 350 03/24/2010 Service Pack 2 SJ Web Edition
    Info: Processing started: Fri Oct 20 10:31:42 2017
Info: Command: quartus_map --read_settings_files=on --write_settings_files=off MIPS -c MIPS
Info: Parallel compilation is enabled and will use 4 of the 4 processors detected
Info: Found 1 design units, including 1 entities, in source file memwrapper.sv
    Info: Found entity 1: MemWrapper
Info: Found 1 design units, including 1 entities, in source file multiplication.sv
    Info: Found entity 1: multiplication
Info: Found 1 design units, including 1 entities, in source file als.sv
    Info: Found entity 1: ALS
Info: Found 1 design units, including 1 entities, in source file extract_lsb.sv
    Info: Found entity 1: Extract_LSB
Info: Found 1 design units, including 1 entities, in source file signextend.sv
    Info: Found entity 1: SignExtend
Info: Found 1 design units, including 1 entities, in source file control.sv
    Info: Found entity 1: Control
Info: Found 2 design units, including 1 entities, in source file banco_reg.vhd
    Info: Found design unit 1: Banco_reg-behavioral_arch
    Info: Found entity 1: Banco_reg
Info: Found 2 design units, including 1 entities, in source file instr_reg.vhd
    Info: Found design unit 1: Instr_Reg-behavioral_arch
    Info: Found entity 1: Instr_Reg
Info: Found 3 design units, including 1 entities, in source file memoria.vhd
    Info: Found design unit 1: ram_constants
    Info: Found design unit 2: Memoria-behavioral_arch
    Info: Found entity 1: Memoria
Info: Found 2 design units, including 1 entities, in source file regdesloc.vhd
    Info: Found design unit 1: RegDesloc-behavioral_arch
    Info: Found entity 1: RegDesloc
Info: Found 2 design units, including 1 entities, in source file registrador.vhd
    Info: Found design unit 1: Registrador-behavioral_arch
    Info: Found entity 1: Registrador
Info: Found 2 design units, including 1 entities, in source file ula32.vhd
    Info: Found design unit 1: Ula32-behavioral
    Info: Found entity 1: Ula32
Info: Found 1 design units, including 1 entities, in source file mips.sv
    Info: Found entity 1: MIPS
Info: Found 5 design units, including 5 entities, in source file mux.sv
    Info: Found entity 1: Mux32bits_4x2
    Info: Found entity 2: Mux5bit_2x1
    Info: Found entity 3: Mux32bit_2x1
    Info: Found entity 4: Mux32bit_8x1
    Info: Found entity 5: Mux5bits_4x2
Info: Found 1 design units, including 1 entities, in source file zeroextension.sv
    Info: Found entity 1: ZeroExtension
Warning (10236): Verilog HDL Implicit Net warning at MIPS.sv(186): created implicit net for "RGD_reset"
Warning (10236): Verilog HDL Implicit Net warning at MIPS.sv(187): created implicit net for "RGD_load"
Critical Warning (10846): Verilog HDL Instantiation warning at ALS.sv(23): instance has no name
Critical Warning (10846): Verilog HDL Instantiation warning at MIPS.sv(188): instance has no name
Info: Elaborating entity "MIPS" for the top level hierarchy
Info: Elaborating entity "SignExtend" for hierarchy "SignExtend:SignEx"
Info: Elaborating entity "Control" for hierarchy "Control:comb_281"
Warning (10272): Verilog HDL Case Statement warning at Control.sv(4181): case item expression covers a value already covered by a previous case item
Info: Elaborating entity "Registrador" for hierarchy "Registrador:ProgramCounter"
Info: Elaborating entity "Mux32bits_4x2" for hierarchy "Mux32bits_4x2:MemMux"
Info: Elaborating entity "MemWrapper" for hierarchy "MemWrapper:MemDataSizeHandler"
Info: Elaborating entity "Memoria" for hierarchy "Memoria:Memory"
Info: Elaborating entity "LPM_RAM_DQ" for hierarchy "Memoria:Memory|LPM_RAM_DQ:MEM"
Info: Elaborated megafunction instantiation "Memoria:Memory|LPM_RAM_DQ:MEM"
Info: Instantiated megafunction "Memoria:Memory|LPM_RAM_DQ:MEM" with the following parameter:
    Info: Parameter "LPM_WIDTH" = "8"
    Info: Parameter "LPM_WIDTHAD" = "8"
    Info: Parameter "LPM_NUMWORDS" = "0"
    Info: Parameter "LPM_INDATA" = "REGISTERED"
    Info: Parameter "LPM_ADDRESS_CONTROL" = "REGISTERED"
    Info: Parameter "LPM_OUTDATA" = "REGISTERED"
    Info: Parameter "LPM_FILE" = "instrucoes.mif"
    Info: Parameter "LPM_TYPE" = "LPM_RAM_DQ"
    Info: Parameter "USE_EAB" = "ON"
    Info: Parameter "INTENDED_DEVICE_FAMILY" = "UNUSED"
    Info: Parameter "LPM_HINT" = "UNUSED"
Info: Elaborating entity "altram" for hierarchy "Memoria:Memory|LPM_RAM_DQ:MEM|altram:sram"
Warning: Assertion warning: altram does not support Cyclone II device family -- attempting best-case memory conversions, but power-up states and read during write behavior will be different for Cyclone II devices
Info: Elaborated megafunction instantiation "Memoria:Memory|LPM_RAM_DQ:MEM|altram:sram", which is child of megafunction instantiation "Memoria:Memory|LPM_RAM_DQ:MEM"
Info: Elaborating entity "altsyncram" for hierarchy "Memoria:Memory|LPM_RAM_DQ:MEM|altram:sram|altsyncram:ram_block"
Info: Elaborated megafunction instantiation "Memoria:Memory|LPM_RAM_DQ:MEM|altram:sram|altsyncram:ram_block", which is child of megafunction instantiation "Memoria:Memory|LPM_RAM_DQ:MEM"
Info: Found 1 design units, including 1 entities, in source file db/altsyncram_e1a1.tdf
    Info: Found entity 1: altsyncram_e1a1
Info: Elaborating entity "altsyncram_e1a1" for hierarchy "Memoria:Memory|LPM_RAM_DQ:MEM|altram:sram|altsyncram:ram_block|altsyncram_e1a1:auto_generated"
Info: Elaborating entity "Instr_Reg" for hierarchy "Instr_Reg:Instruction_Register"
Info: Elaborating entity "ZeroExtension" for hierarchy "ZeroExtension:MDRExtract"
Info: Elaborating entity "Mux32bit_8x1" for hierarchy "Mux32bit_8x1:WriteDataMux"
Info: Elaborating entity "Mux5bits_4x2" for hierarchy "Mux5bits_4x2:WriteRegMux"
Info: Elaborating entity "Banco_reg" for hierarchy "Banco_reg:Registers"
Info: Elaborating entity "Mux32bit_2x1" for hierarchy "Mux32bit_2x1:LHS_Mux"
Info: Elaborating entity "Mux5bit_2x1" for hierarchy "Mux5bit_2x1:ShiftAmountMux"
Info: Elaborating entity "ALS" for hierarchy "ALS:ALU"
Info: Elaborating entity "Ula32" for hierarchy "ALS:ALU|Ula32:ALU"
Info: Elaborating entity "RegDesloc" for hierarchy "ALS:ALU|RegDesloc:DESL"
Warning (10492): VHDL Process Statement warning at RegDesloc.vhd(1102): signal "temp" is read inside the Process Statement but isn't in the Process Statement's sensitivity list
Info: Elaborating entity "multiplication" for hierarchy "ALS:ALU|multiplication:comb_3"
Warning: 2 hierarchies have connectivity warnings - see the Connectivity Checks report folder
Warning: Output pins are stuck at VCC or GND
    Warning (13410): Pin "Estado[7]" is stuck at GND
Info: 8 registers lost all their fanouts during netlist optimizations. The first 8 are displayed below.
    Info: Register "Control:comb_281|state~4" lost all its fanouts during netlist optimizations.
    Info: Register "Control:comb_281|state~5" lost all its fanouts during netlist optimizations.
    Info: Register "Control:comb_281|state~6" lost all its fanouts during netlist optimizations.
    Info: Register "Control:comb_281|state~7" lost all its fanouts during netlist optimizations.
    Info: Register "Control:comb_281|state~8" lost all its fanouts during netlist optimizations.
    Info: Register "Control:comb_281|state~9" lost all its fanouts during netlist optimizations.
    Info: Register "Control:comb_281|state~10" lost all its fanouts during netlist optimizations.
    Info: Register "Control:comb_281|state~11" lost all its fanouts during netlist optimizations.
Info: Generated suppressed messages file C:/Users/jraf/Documents/Mips/MIPS.map.smsg
Info: Implemented 4730 device resources after synthesis - the final resource count might be different
    Info: Implemented 2 input pins
    Info: Implemented 544 output pins
    Info: Implemented 4152 logic cells
    Info: Implemented 32 RAM segments
Info: Quartus II Analysis & Synthesis was successful. 0 errors, 10 warnings
    Info: Peak virtual memory: 278 megabytes
    Info: Processing ended: Fri Oct 20 10:31:59 2017
    Info: Elapsed time: 00:00:17
    Info: Total CPU time (on all processors): 00:00:17


+------------------------------------------+
; Analysis & Synthesis Suppressed Messages ;
+------------------------------------------+
The suppressed messages can be found in C:/Users/jraf/Documents/Mips/MIPS.map.smsg.


